530AB1024M00BG【PDF 9/15 页】CRYSTAL OSCILLATOR, CLOCK, 1024 MHz, LVP

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Si530/531

Rev. 1.0

Table 3. CLK± Output Levels and Symmetry

Parameter

Symbol

Test Condition

Min

Typ

Max

Units

LVPECL Output Option1

mid-level

VDD – 1.42

—

VDD – 1.25

VOD

swing (diff)

1.1

—

1.9

VPP

VSE

swing (single-ended)

0.5

—

0.93

VPP

LVDS Output Option2

mid-level

1.125

1.20

1.275

VOD

swing (diff)

0.32

0.40

0.50

VPP

CML Output Option2

mid-level

—

VDD – 0.75

—

VOD

swing (diff)

0.70

0.95

1.20

VPP

CMOS Output Option3

VOH

IOH =32mA

0.8 x VDD

—

VDD

VOL

IOL =32mA

—

0.4

Rise/Fall time (20/80%)

tR, tF

LVPECL/LVDS/CML

—

350

CMOS with CL = 15 pF

—

Symmetry (duty cycle)

SYM

LVPECL:

VDD – 1.3 V (diff)

LVDS:

1.25 V (diff)

CMOS:

VDD/2

—

Notes:

1. 50

to VDD – 2.0 V.

2. Rterm = 100 (differential).

3. CL = 15 pF

Table 4. CLK± Output Phase Jitter

Parameter

Symbol

Test Condition

Min

Typ

Max

Units

Phase Jitter (RMS)*

for FOUT > 500 MHz

12 kHz to 20 MHz (OC-48)

—

0.40

0.50

50 kHz to 80 MHz (OC-192)

LVPECL

CML

LVDS

—

0.30

0.35

0.40

0.47

0.49

Phase Jitter (RMS)*

for FOUT of 125 to 500 MHz

12 kHz to 20 MHz (OC-48)

LVPECL

CML

LVDS

—

0.40

0.45

0.50

0.52

*Note: Differential Modes: LVPECL/LVDS/CML. Refer to AN256 for further information.

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